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Mainboard ESC Model A33G | D C B A 8 ITE8716 GP44 GP4 2 GP41 AR1 AR2 AR3 H L 7 real S3 pseudo S3 reserve reserve 6 5 System Block Diagram 4 3 2 1 P.19 DDRII SDRAM 266 333 DDRII 1 2 P.7 P.8 SSTL-2 Termination Rtt D Power RTCVDD VCORE VCC1.8V IVDD SB1.8V SB3V DDR VTT VCC3.3 SB5V VCC5 12V -5V -12V VCC DIMM VCC5DUAL VCC2.5V VLDT P.32 P.33 Regulator P.34 Regulator P.34 35 37 P.36 P.36 ATX POWER Power OK Power Sequence Voltage Switch P.37 C B A P.26 P.25 P.26 P.27 Title Size B Elitegroup Computer Systems 761GX System Block Diagram Document Number Date Monday May 08 2006 Rev 1.0 37 Q 7 O 4 3 2 1 A 3P Elitegroup Computer Systems itle Cover Page Hze Document Number ev 1 R161 R157 2 51-1-04L0 CTLIN H1 V4 2 51-1-04L0_CTLIN_L1 V5 L0 CTLIN H0 1 L0_CTLIN_L0 V1 L0_CLKIN_H1 N6 L0_CLKIN_L1 P6 L0_CLKIN_H0 N3 L0_CLKIN_L0 N2 CPU1A HYPERTRANSPORT L0_CLKIN_H 1 L0_CLKIN_L 1 L0_CLKIN_H 0 L0_CLKIN_L 0 L0_CLKOUT_H 1 L0_CLKOUT_L 1 L0_CLKOUT_H 0 L0_CLKOUT_L 0 AD5 L0 CLKOUT H1 AD4_ L0_CLKOUT_L1 ADV L0_CLKOUT_H0 ACV L0_CLKOUT_L0 L0_CLKOUT_H1 9 L0_CLKOUT_L1 9 L0_CLKOUT_H0 9 L0_CLKOUT_L0 CPU1E C L0_ CADIN H15 U6 L0_ CADIN_ L15 V6 L0_ CADIN _H14 T4 L0_ CADIN_ L14 T5 L0_ CADIN _H13 R6 L0_ CADIN_ L13 T6 L0_ CADIN _H12 P4 L0_ CADIN_ L12 P5 L0_ CADIN _H11 M4 L0_ CADIN_ L11 M5 L0_ CADIN _H10 L6 L0_ CADIN_ L10 M6 L0_ CADIN _H9 K4 L0_ CADIN _L9 K5 L0_ CADIN _H8 J6 L0_ CADIN _L8 K6 L0_CTLIN_H 1 L0_CTLIN_L 1 L0_CTLIN_H 0 L0_CTLIN_L 0 L0_CTLOUT_H 1 L0_CTLOUT_L 1 L0_CTLOUT_H 0 L0_CTLOUT_L 0 Y6 L0 CTLOUT H1 1 STP11 W _ L0_CTLOUT_L1 1 STP10 W2 L0_CTLOUT_H .S L0 ÇTLOUTH0 W3---L0CTLOUTL0 g L0_CTLOUT_L0 9 9 L0_CADIN_H 15 L0_CADIN_L 15 L0_CADIN_H 14 L0_CADIN_L 14 L0_CADIN_H 13 L0 CADIN L 13 L0_CADIN_H 12 L0_CADIN_L 12 L0_CADIN_H 11 L0_CADIN_L 11 L0_CADIN_H 10 L0_CADIN_L 10 L0_CADIN_H 9 L0_CADIN_L 9 L0_CADIN_H 8 L0_CADIN_L 8 L0_CADOUT_H 15 L0_CADOUT_L 15 L0_CADOUT_H 14 L0_CADOUT_L 14 L0_CADOUT_H 13 L0_CADOUT_L 13 L0_CADOUT_H 12 L0_CADOUT_L 12 L0_CADOUT_H 11 L0_CADOUT_L 11 L0_CADOUT_H 10 L0_CADOUT_L 10 L0_CADOUT_H 9 L0_CADOUT_L 9 L0_CADOUT_H
