TAILIEUCHUNG - KẾ CẤU MÁY TÍNH - VI XỬ LÝ - TỔ CHỨC NHẬP XUÂT DỮ LIỆU

Mạch tạo xung nhịp 8284 Mạch tạo xung nhịp dùng để cung cấp xung nhịp cho µP. 1 2 3 4 5 6 7 8 9 CSY NC VCC PCLK X1 AEN1 X2 RDY 1 ASY NC READY EFI RD2 F/C AEN2 OSC CLK RES GND RESET 18 17 16 15 14 13 12 11 10 8284 Hình – Mạch tạo xung nhịp 8284 CSYNC (Clock Synchronisation): ngõ vào xung đồng bộ chung khi hệ thống có các 8284 dùng dao động ngoài tại chân EFI. Khi dùng mạch dao động trong thì phải nối đất. PCLK (Peripheral Clock): xung nhịp f. | Tài liệu vi xử lỷ Tổ chức nhập xuất CHƯƠNG 4 TỔ CHỨC NHẬP XUẤT 1. Các mạch phụ trợ 8284 và 8288 . Mạch tạo xung nhịp 8284 Mạch tạo xung nhịp dùng để cung cấp xung nhịp cho pP. D D D D D D D D D 1 CSYNC VCC PCLK X1 AEN1 X2 RDY1 ASYNC READY EFI RD2 F C AEN2 OSC CLK RES GND RESET 18 2 17 3 16 4 15 5 14 6 13 7 12 8 11 9 10 a a a o o a a a a 8284 Hình - Mạch tạo xung nhịp 8284 CSYNC Clock Synchronisation ngõ vào xung đồng bộ chung khi hệ thống có các 8284 dùng dao động ngoài tại chân EFI. Khi dùng mạch dao động trong thì phải nối đất. PCLK Peripheral Clock xung nhịp f fX 6 fX là tần số thạch anh AEN1 AEN2 Address Enable cho phép chọn các chân RDY1 RDY2 báo hiệu trạng thái sẵn sàng của bộ nhớ hay thiết bị ngoại vi Vcc 16 VCC CSYNC X1 PCLK X2 AEN1 ASYNC RDY1 EFL READY F C RD2 OSC AEN2 RES CLK RESET GND 1 2 3 4 5 6 7 8 9 8284 Hình - Mạch khởi động cho 8284 RDY1 RDY2 Bus ready tạo các chu kỳ đợi ở CPU Phạm Hùng Kim Khánh Trang 74 Tài liệu vi xử lỷ Tổ chức nhập xuất READY nối đến chân READY của pP. CLK Clock xung nhịp f fX 3 nối với chân CLK của pP. RESET nối với chân RESET của pP là tín hiệu khởi động lại toàn hệ thống RES Reset Input chân khởi động cho 8284 OSC ngõ ra xung nhịp có tần số fX F C Frequency Crystal chọn nguồn tín hiệu chuẩn cho 8284 nếu ở mức cao thì chọn tần số xung nhịp bên ngoài ngược lại thì dùng xung nhịp từ thạch anh EFI External Frequency Input xung nhịp từ bộ dao động ngoài ASYNC chọn chế độ làm việc cho tín hiệu RDY. X1 X2 ngõ vào của thạch anh . Mạch điều khiển bus 8288 Mạch điều khiển bus 8288 lấy một số tín hiệu điều khiển của pP và cung cấp các tín hiệu điều khiển cần thiết cho hệ vi xử lý. D D D D D D 1 IOB VCC CLK S0 S1 _ S2 DT R MCE PDEN ALE DEN AEN CEN MRDC INTA AMWC IORC MWTC AIOWC GND IOWC 20 2 19 3 18 4 17 5 16 6 15 7 14 8 13 9 12 10 11 a a a a a a o a o a 8288 Hình - Mạch điều khiển bus 8288 IOB Input Output Bus Mode điều khiển để 8288 làm việc ở các chế độ bus khác nhau. CLK Clock ngõ vào lấy từ xung nhịp hệ thống. S2 .

TÀI LIỆU LIÊN QUAN
TỪ KHÓA LIÊN QUAN
Đã phát hiện trình chặn quảng cáo AdBlock
Trang web này phụ thuộc vào doanh thu từ số lần hiển thị quảng cáo để tồn tại. Vui lòng tắt trình chặn quảng cáo của bạn hoặc tạm dừng tính năng chặn quảng cáo cho trang web này.